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按需功能验证训练库金宝搏娱乐城
此库包含帮助您掌握功能验证工具的学习路径，以及使用基于HDL的方法开发测试环境。
学习如何使用ModelSim/Questa GUI和命令行来验证和调试交互式模式下的HDL设计，或者为快速模拟构建批处理模式脚本。
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学习路径让你专注于发展你最需要的技能。
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在此学习路径中，您将学习SystemVerilog基础知识，如块、数据类型和运算符。
在此学习路径中，您将学习使用Questa inFact PSS生成便携式刺激，并比其他刺激生成方法更快地实现覆盖。
了解如何导航导师学习中心和查看功能验证库的课程地图。
在此学习路径中，您将学习SystemVerilog面向对象编程和进程间通信。
学习如何使用ModelSim/Questa GUI和命令行来验证和调试交互式模式下的HDL设计，或者为快速模拟构建批处理模式脚本。
这个学习路径涵盖了HDL设计器（HDS）的核心操作、框图的使用、状态机编辑器以及如何从HDS控制仿真
在本学习路径中，您将学习SystemVerilog约束随机生成和函数覆盖。
此学习路径使您能够扩展ModleSim/QuestaSim功能的知识，并有效地分析和调试HDL代码。
本学习路径涵盖如何管理团队运作的HDS、如何分析现有设计、如何生成文档以及如何使用第三方IP。
在此学习路径中，您将学习如何使用通用验证方法（UVM）来创建可重用的验证环境。
此学习路径帮助您掌握Questa的高级功能验证环境，以便管理测试和调试验证bug。
此学习路径支持用户编写rtl代码。它可以帮助他们实现他们公司的设计准则，作为一个规则集，可以通过designchecker进行测试。188beat
了解如何使用UVM框架，类库和代码生成器，Questa®验证解决方案的一部分快速构建复杂的UVM TestBenches。
在本学习路径中，您将学习如何使用Visualizer调试环境来验证您的设计。
了解时钟域交叉（CDC）设计和验证，以及如何使用Questa CDC验证异步时钟域之间的路径。
创建硬件寄存器和内存的UVM寄存器层描述，集成到UVM测试台中，并用方法和序列验证您的设计。
了解如何使用UVM框架和Questa验证IP（QVIP）为IP核构建UVM测试台。
在本学习路径中，您将获得SystemC的概述，并学习如何在Questa中模拟SystemC设计。
了解SystemVerilog中各种类型的数组。这包括固定和动态数组、队列和关联数组。
了解刺激生成过程以及如何将现有的UVM TestBench导入Infact-PSS环境。
了解如何使用实际PSS运行回归。
了解如何使用Infact PSS覆盖发生器生成覆盖目标。
了解如何创建情景与便携式刺激与影响PSS。
本章介绍SystemVerilog OOP中的基本概念和操作
本章中的故事板文档概述了整个学习过程。
本章概述了模拟过程。您将了解QuestaSim和ModelSim的特性以及如何使用帮助和文档。
您将了解HDL Designer中所有或大多数设计输入工具所共有的特性
了解随机测试方法和SystemVerilog约束随机测试
本章介绍了TCL / TK语言的简要概述，并展示了如何在Modesim或Questasim中使用它。
了解如何将现有的HDL文本设计导入到HDL项目中。支持对文本文件进行图形分析，并将其转换为图形源。
了解如何使用UVM事务和序列创建刺激。
本章中的故事板文档概述了整个学习过程。
本章介绍如何创建测试环境、分析模拟后运行、将测试计划与测试运行合并以及如何生成HTML覆盖率报告。
本章介绍如何操作和导出DesignChecker结果、如何分析设计质量以及如何使用排除。
本章解释了UVM框架的优点，描述了测试中的设计，并介绍了UVM框架的流程。
本章中的故事板文档概述了整个学习过程。
本章提供可视化工具的概述。您将了解Visualizer的典型使用流程以及如何使用帮助和文档。
本章提供了对基本CDC验证过程的理解。您将学习如何设置和运行Questa CDC以及如何分析CDC结果。
UVM框架QVIP集成
我们的按需培训平台可以在短期金宝搏娱乐城，外用课程，包含视频，知识评估和互动虚拟实验室练习中获得数百小时的按需培训。
学习路径按角色和任务划分，以帮助加速工具的使用。获得快速的视觉访问以查看章节、主题和学习路径，以及章节内的进度跟踪。
视频内容展示了Mentor软件的实际应用。使用虚拟实验室进行导金宝博滚球专家师产品的实际访问。评估检查以确认您的知识。
积分以总体完成完成，并在完成学习路径后提供证书和成绩单。
