HDL设计器

HDL设计器combines deep analysis capabilities,高级创建编辑器,完成项目和流程管理,提供强大的HDL设计环境,提高单个工程师和团队(本地或远程)的工作效率,并实现可重复和可预测的设计过程。

特点和优点

关键利益

  • Manages complex ASIC or FPGA designs in VHDL,Verilog和SystemVerilog
  • 加速RTL重用
  • Extensive design checking rules and rulesets
  • Interactive HDL visualization and creation tools
  • 自动文档功能和报告
  • 智能调试与分析
  • 并行设计输入和检查

设计和重用

  • Quickly assess reused code quality and increase design understanding
  • 使用文本高效地创建RTL设计,tables,and graphics
  • 交互管理设计流程和所有项目数据
  • Rapidly produce documentation
  • Accelerate IP repository population

系统语言

  • Manage and understand code relationships
  • 提高语言能力和学习效果
  • 总结和量化代码特征
  • 自动化和简化数据管理
  • 设计,实际代码重用的度量和文档

Highlights

Analyze

HDL Designer assists engineers in analyzing,评估,and visualizing complex RTL designs,providing code integrity analysis,connectivity completeness analysis,HDL代码质量评估,以及设计可视化。


创造

Hand-in-hand with code analysis is code creation.HDL Designer为工程师提供了一套高级设计编辑器,以促进开发:基于接口的设计电子表格编辑器(IBD)和框图,状态机,truth table,流程图和算法状态机编辑器。为了补充这些编辑,HDL Designer includes an EMACS/vi-compatible,支持HDL的文本编辑器。

管理

结合设计分析与创作,design management is the third important task facing designers.在管理设计数据的同时,teams need to manage the project throughout the design flow.

HDL设计器通过向设计器提供流中其他设计工具的接口来解决设计管理问题;数据和版本管理解决方案。

HDL Designer还可以通过HTML轻松设计和完整的项目文档,好啊,print,和图形输出。


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